单项选择题
下图是一个仅用NMOS传输管构成多路开关的多路开关型NMOS锁存器，在时钟的（）阶段，输入D被传送到主级的输出端QM，（）处于维持状态。在时钟的（）阶段，从级对主级的输出端QM采样，（）处于维持状态。
A.低电平，从级，高电平，主级
B.低电平，主级，高电平，从级
C.高电平，主级，低电平，从级
D.高电平，从级，低电平，主级
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单项选择题
以下哪个不是降低开关活动性的设计技术？（）
A.改变逻辑电路的拓扑结构
B.提前输入具有较高翻转率的信号
C.分时复用资源
D.通过均衡信号路径来减少毛刺 -
单项选择题
假设一反相器和两输入与非门中的器件PMOS与NMOS的尺寸比为2，最小尺寸的对称反相器的输入电容等于最小尺寸NMOS管栅电容的3倍。若该NAND门的等效电阻等于该反相器的电阻，那么它的逻辑努力（logical effort）为（）。
A.4/3
B.5/3
C.2/3
D.1 -
单项选择题
在设计大扇入电路时，可以采取多种技术来降低其电路延时，以下不是降低延时的方法是（）。
A.逐级加大晶体管尺寸
B.将关键路径上的晶体管调整至靠近门的输入端
C.变换逻辑来减少单个门的输入信号个数
D.调整晶体管尺寸
